El GE IC693MDL655, también catalogado como Módulo de Entrada Discreta IC693MDL655, funciona como un componente de hardware dedicado para la monitorización de estados binarios dentro de las plataformas de la Serie 90-30. El componente de alta densidad interconecta interruptores de campo, pulsadores y sensores de proximidad a través del backplane al convertir entradas de voltaje nominal de 24 VDC en bits de estado de nivel lógico.
| Parámetro | Especificación |
|---|---|
| Modelo | IC693MDL655 |
| Marca | GE Fanuc Emerson |
| Origen | EE. UU. |
| Peso | 0.28 kg (0.63 lbs) |
| Dimensiones | Perfil de placa base de una sola ranura |
| Temperatura de Operación | 0 a 60 grados C |
| Consumo de Energía | 195 mA a 5 VDC (bus de backplane); 224 mA a 24 VDC |
| Número de Canales de Entrada | 32 puntos (organizados en 4 grupos aislados de 8 canales) |
| Voltaje Nominal de Entrada | 24 VDC |
| Rango de Voltaje de Entrada | 0 a 30 VDC |
| Configuración Lógica | Lógica positiva / negativa (Sink / Source) |
| Corriente Nominal de Entrada | 7 mA por canal a 24 VDC |
| Umbral de Estado ON | 11.5 a 30.0 VDC (3.2 mA de corriente mínima) |
| Umbral de Estado OFF | 0 a 5 VDC (1.1 mA de corriente máxima) |
| Retardo del Filtro de Señal | 2 ms máximo (Respuesta típica On / Off) |
| Aislamiento Dieléctrico | 1500 V entre circuitos de campo y lado lógico mediante optoacopladores |
| Interfaz del Panel Frontal | 2 conectores macho Fujitsu FCN-365P024-AU de 24 pines |
El IC693MDL655 utiliza configuraciones internas fijas de optoacopladores para transferir de forma segura los estados de la señal al bus lógico sin introducir retardos de propagación ni comprometer los parámetros de velocidad de comunicación del bus del backplane. El diseño de alta densidad de 32 puntos permite perfiles de escalado predecibles de densidad de E/S en placas base locales, de expansión o remotas de 5 y 10 ranuras. La compatibilidad con firmware flash integrado garantiza bloques de procesamiento sincronizados, lo que permite que los cuatro grupos discretos se actualicen dentro de los límites de escaneo definidos mientras se activan los LED de estado del panel frontal (A1-A8, B1-B8, C1-C8, D1-D8) sin fluctuación de tiempo de bucle.
P: ¿Cómo se realiza el cableado físico dada la alta densidad de los canales de entrada?
R: El panel frontal carece de terminales de tornillo estándar. Las conexiones se enrutan a través de dos conectores macho Fujitsu FCN-365P024-AU de 24 pines preinstalados, lo que requiere el uso de cables precableados coincidentes como el IC693CBL327 o el IC693CBL328.
P: ¿Se pueden mezclar diferentes tipos de lógica eléctrica en los cuatro grupos de entrada separados?
R: Sí. Dado que los 32 canales están divididos en cuatro grupos aislados distintos de ocho puntos (Grupos A, B, C y D), cada grupo independiente puede cablearse para lógica positiva (sink) o lógica negativa (source) de forma independiente.
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